1
2
3
4
5
6 #ifndef _DT_BINDINGS_CLK_MSM_GCC_8974_H
7 #define _DT_BINDINGS_CLK_MSM_GCC_8974_H
8
9 #define GPLL0 0
10 #define GPLL0_VOTE 1
11 #define CONFIG_NOC_CLK_SRC 2
12 #define GPLL2 3
13 #define GPLL2_VOTE 4
14 #define GPLL3 5
15 #define GPLL3_VOTE 6
16 #define PERIPH_NOC_CLK_SRC 7
17 #define BLSP_UART_SIM_CLK_SRC 8
18 #define QDSS_TSCTR_CLK_SRC 9
19 #define BIMC_DDR_CLK_SRC 10
20 #define SYSTEM_NOC_CLK_SRC 11
21 #define GPLL1 12
22 #define GPLL1_VOTE 13
23 #define RPM_CLK_SRC 14
24 #define GCC_BIMC_CLK 15
25 #define BIMC_DDR_CPLL0_ROOT_CLK_SRC 16
26 #define KPSS_AHB_CLK_SRC 17
27 #define QDSS_AT_CLK_SRC 18
28 #define USB30_MASTER_CLK_SRC 19
29 #define BIMC_DDR_CPLL1_ROOT_CLK_SRC 20
30 #define QDSS_STM_CLK_SRC 21
31 #define ACC_CLK_SRC 22
32 #define SEC_CTRL_CLK_SRC 23
33 #define BLSP1_QUP1_I2C_APPS_CLK_SRC 24
34 #define BLSP1_QUP1_SPI_APPS_CLK_SRC 25
35 #define BLSP1_QUP2_I2C_APPS_CLK_SRC 26
36 #define BLSP1_QUP2_SPI_APPS_CLK_SRC 27
37 #define BLSP1_QUP3_I2C_APPS_CLK_SRC 28
38 #define BLSP1_QUP3_SPI_APPS_CLK_SRC 29
39 #define BLSP1_QUP4_I2C_APPS_CLK_SRC 30
40 #define BLSP1_QUP4_SPI_APPS_CLK_SRC 31
41 #define BLSP1_QUP5_I2C_APPS_CLK_SRC 32
42 #define BLSP1_QUP5_SPI_APPS_CLK_SRC 33
43 #define BLSP1_QUP6_I2C_APPS_CLK_SRC 34
44 #define BLSP1_QUP6_SPI_APPS_CLK_SRC 35
45 #define BLSP1_UART1_APPS_CLK_SRC 36
46 #define BLSP1_UART2_APPS_CLK_SRC 37
47 #define BLSP1_UART3_APPS_CLK_SRC 38
48 #define BLSP1_UART4_APPS_CLK_SRC 39
49 #define BLSP1_UART5_APPS_CLK_SRC 40
50 #define BLSP1_UART6_APPS_CLK_SRC 41
51 #define BLSP2_QUP1_I2C_APPS_CLK_SRC 42
52 #define BLSP2_QUP1_SPI_APPS_CLK_SRC 43
53 #define BLSP2_QUP2_I2C_APPS_CLK_SRC 44
54 #define BLSP2_QUP2_SPI_APPS_CLK_SRC 45
55 #define BLSP2_QUP3_I2C_APPS_CLK_SRC 46
56 #define BLSP2_QUP3_SPI_APPS_CLK_SRC 47
57 #define BLSP2_QUP4_I2C_APPS_CLK_SRC 48
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62 #define BLSP2_QUP6_SPI_APPS_CLK_SRC 53
63 #define BLSP2_UART1_APPS_CLK_SRC 54
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70 #define CE2_CLK_SRC 61
71 #define GP1_CLK_SRC 62
72 #define GP2_CLK_SRC 63
73 #define GP3_CLK_SRC 64
74 #define PDM2_CLK_SRC 65
75 #define QDSS_TRACECLKIN_CLK_SRC 66
76 #define RBCPR_CLK_SRC 67
77 #define SDCC1_APPS_CLK_SRC 68
78 #define SDCC2_APPS_CLK_SRC 69
79 #define SDCC3_APPS_CLK_SRC 70
80 #define SDCC4_APPS_CLK_SRC 71
81 #define SPMI_AHB_CLK_SRC 72
82 #define SPMI_SER_CLK_SRC 73
83 #define TSIF_REF_CLK_SRC 74
84 #define USB30_MOCK_UTMI_CLK_SRC 75
85 #define USB_HS_SYSTEM_CLK_SRC 76
86 #define USB_HSIC_CLK_SRC 77
87 #define USB_HSIC_IO_CAL_CLK_SRC 78
88 #define USB_HSIC_SYSTEM_CLK_SRC 79
89 #define GCC_BAM_DMA_AHB_CLK 80
90 #define GCC_BAM_DMA_INACTIVITY_TIMERS_CLK 81
91 #define GCC_BIMC_CFG_AHB_CLK 82
92 #define GCC_BIMC_KPSS_AXI_CLK 83
93 #define GCC_BIMC_SLEEP_CLK 84
94 #define GCC_BIMC_SYSNOC_AXI_CLK 85
95 #define GCC_BIMC_XO_CLK 86
96 #define GCC_BLSP1_AHB_CLK 87
97 #define GCC_BLSP1_SLEEP_CLK 88
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100 #define GCC_BLSP1_QUP2_I2C_APPS_CLK 91
101 #define GCC_BLSP1_QUP2_SPI_APPS_CLK 92
102 #define GCC_BLSP1_QUP3_I2C_APPS_CLK 93
103 #define GCC_BLSP1_QUP3_SPI_APPS_CLK 94
104 #define GCC_BLSP1_QUP4_I2C_APPS_CLK 95
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106 #define GCC_BLSP1_QUP5_I2C_APPS_CLK 97
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108 #define GCC_BLSP1_QUP6_I2C_APPS_CLK 99
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112 #define GCC_BLSP1_UART2_APPS_CLK 103
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130 #define GCC_BLSP2_QUP4_I2C_APPS_CLK 121
131 #define GCC_BLSP2_QUP4_SPI_APPS_CLK 122
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133 #define GCC_BLSP2_QUP5_SPI_APPS_CLK 124
134 #define GCC_BLSP2_QUP6_I2C_APPS_CLK 125
135 #define GCC_BLSP2_QUP6_SPI_APPS_CLK 126
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137 #define GCC_BLSP2_UART1_SIM_CLK 128
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139 #define GCC_BLSP2_UART2_SIM_CLK 130
140 #define GCC_BLSP2_UART3_APPS_CLK 131
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148 #define GCC_BOOT_ROM_AHB_CLK 139
149 #define GCC_CE1_AHB_CLK 140
150 #define GCC_CE1_AXI_CLK 141
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156 #define GCC_CNOC_BUS_TIMEOUT1_AHB_CLK 147
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166 #define GCC_BIMC_DDR_CPLL1_CLK 157
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178 #define GCC_IMEM_CFG_AHB_CLK 169
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180 #define GCC_KPSS_AXI_CLK 171
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183 #define GCC_MMSS_NOC_CFG_AHB_CLK 174
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185 #define GCC_OCMEM_SYS_NOC_AXI_CLK 176
186 #define GCC_MPM_AHB_CLK 177
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188 #define GCC_MSS_CFG_AHB_CLK 179
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190 #define GCC_NOC_CONF_XPU_AHB_CLK 181
191 #define GCC_PDM2_CLK 182
192 #define GCC_PDM_AHB_CLK 183
193 #define GCC_PDM_XO4_CLK 184
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195 #define GCC_PERIPH_NOC_AT_CLK 186
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203 #define GCC_PNOC_BUS_TIMEOUT4_AHB_CLK 194
204 #define GCC_PRNG_AHB_CLK 195
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220 #define GCC_RPM_BUS_AHB_CLK 211
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222 #define GCC_RPM_SLEEP_CLK 213
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229 #define GCC_SDCC2_INACTIVITY_TIMERS_CLK 220
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233 #define GCC_SDCC4_AHB_CLK 224
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239 #define GCC_SEC_CTRL_CLK 230
240 #define GCC_SEC_CTRL_SENSE_CLK 231
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242 #define GCC_SNOC_BUS_TIMEOUT2_AHB_CLK 233
243 #define GCC_SPDM_BIMC_CY_CLK 234
244 #define GCC_SPDM_CFG_AHB_CLK 235
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246 #define GCC_SPDM_FF_CLK 237
247 #define GCC_SPDM_MSTR_AHB_CLK 238
248 #define GCC_SPDM_PNOC_CY_CLK 239
249 #define GCC_SPDM_RPM_CY_CLK 240
250 #define GCC_SPDM_SNOC_CY_CLK 241
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252 #define GCC_SPMI_CNOC_AHB_CLK 243
253 #define GCC_SPMI_SER_CLK 244
254 #define GCC_SNOC_CNOC_AHB_CLK 245
255 #define GCC_SNOC_PNOC_AHB_CLK 246
256 #define GCC_SYS_NOC_AT_CLK 247
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260 #define GCC_SYS_NOC_USB3_AXI_CLK 251
261 #define GCC_TCSR_AHB_CLK 252
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263 #define GCC_TLMM_CLK 254
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266 #define GCC_TSIF_REF_CLK 257
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268 #define GCC_USB2B_PHY_SLEEP_CLK 259
269 #define GCC_USB30_MASTER_CLK 260
270 #define GCC_USB30_MOCK_UTMI_CLK 261
271 #define GCC_USB30_SLEEP_CLK 262
272 #define GCC_USB_HS_AHB_CLK 263
273 #define GCC_USB_HS_INACTIVITY_TIMERS_CLK 264
274 #define GCC_USB_HS_SYSTEM_CLK 265
275 #define GCC_USB_HSIC_AHB_CLK 266
276 #define GCC_USB_HSIC_CLK 267
277 #define GCC_USB_HSIC_IO_CAL_CLK 268
278 #define GCC_USB_HSIC_IO_CAL_SLEEP_CLK 269
279 #define GCC_USB_HSIC_SYSTEM_CLK 270
280 #define GCC_WCSS_GPLL1_CLK_SRC 271
281 #define GCC_MMSS_GPLL0_CLK_SRC 272
282 #define GCC_LPASS_GPLL0_CLK_SRC 273
283 #define GCC_WCSS_GPLL1_CLK_SRC_SLEEP_ENA 274
284 #define GCC_MMSS_GPLL0_CLK_SRC_SLEEP_ENA 275
285 #define GCC_LPASS_GPLL0_CLK_SRC_SLEEP_ENA 276
286 #define GCC_IMEM_AXI_CLK_SLEEP_ENA 277
287 #define GCC_SYS_NOC_KPSS_AHB_CLK_SLEEP_ENA 278
288 #define GCC_BIMC_KPSS_AXI_CLK_SLEEP_ENA 279
289 #define GCC_KPSS_AHB_CLK_SLEEP_ENA 280
290 #define GCC_KPSS_AXI_CLK_SLEEP_ENA 281
291 #define GCC_MPM_AHB_CLK_SLEEP_ENA 282
292 #define GCC_OCMEM_SYS_NOC_AXI_CLK_SLEEP_ENA 283
293 #define GCC_BLSP1_AHB_CLK_SLEEP_ENA 284
294 #define GCC_BLSP1_SLEEP_CLK_SLEEP_ENA 285
295 #define GCC_BLSP2_AHB_CLK_SLEEP_ENA 286
296 #define GCC_BLSP2_SLEEP_CLK_SLEEP_ENA 287
297 #define GCC_PRNG_AHB_CLK_SLEEP_ENA 288
298 #define GCC_BAM_DMA_AHB_CLK_SLEEP_ENA 289
299 #define GCC_BAM_DMA_INACTIVITY_TIMERS_CLK_SLEEP_ENA 290
300 #define GCC_BOOT_ROM_AHB_CLK_SLEEP_ENA 291
301 #define GCC_MSG_RAM_AHB_CLK_SLEEP_ENA 292
302 #define GCC_TLMM_AHB_CLK_SLEEP_ENA 293
303 #define GCC_TLMM_CLK_SLEEP_ENA 294
304 #define GCC_SPMI_CNOC_AHB_CLK_SLEEP_ENA 295
305 #define GCC_CE1_CLK_SLEEP_ENA 296
306 #define GCC_CE1_AXI_CLK_SLEEP_ENA 297
307 #define GCC_CE1_AHB_CLK_SLEEP_ENA 298
308 #define GCC_CE2_CLK_SLEEP_ENA 299
309 #define GCC_CE2_AXI_CLK_SLEEP_ENA 300
310 #define GCC_CE2_AHB_CLK_SLEEP_ENA 301
311 #define GPLL4 302
312 #define GPLL4_VOTE 303
313 #define GCC_SDCC1_CDCCAL_SLEEP_CLK 304
314 #define GCC_SDCC1_CDCCAL_FF_CLK 305
315
316
317 #define USB_HS_HSIC_GDSC 0
318
319 #endif