DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT 14230 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_1_0_sh_mask.h #define DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT                                                         0x0
DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT 17691 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_2_0_0_sh_mask.h #define DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT                                                         0x0
DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT 14623 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_2_1_0_sh_mask.h #define DPP_TOP1_DPP_CRC_VAL_R_G__DPP_CRC_R_CR__SHIFT                                                         0x0