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mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX 8400 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_1_0_offset.h #define mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX                                                            2
mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX 10993 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_2_0_0_offset.h #define mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX                                                            2
mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX 9899 drivers/gpu/drm/amd/include/asic_reg/dcn/dcn_2_1_0_offset.h #define mmDP0_DP_DPHY_CRC_MST_CNTL_BASE_IDX                                                            2