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mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX 4601 drivers/gpu/drm/amd/include/asic_reg/gc/gc_9_0_offset.h #define mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX                                                             1
mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX 4853 drivers/gpu/drm/amd/include/asic_reg/gc/gc_9_1_offset.h #define mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX                                                             1
mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX 4809 drivers/gpu/drm/amd/include/asic_reg/gc/gc_9_2_1_offset.h #define mmCP_SC_PSINVOC_COUNT1_LO_BASE_IDX                                                             1