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81 pending = readl(ks_pcie->va_app_base + MSI0_IRQ_STATUS + (offset << 4)); in ks_dw_pcie_handle_msi_irq()112 ks_pcie->va_app_base + MSI0_IRQ_STATUS + (reg_offset << 4)); in ks_dw_pcie_msi_irq_ack()113 writel(reg_offset + MSI_IRQ_OFFSET, ks_pcie->va_app_base + IRQ_EOI); in ks_dw_pcie_msi_irq_ack()123 ks_pcie->va_app_base + MSI0_IRQ_ENABLE_SET + (reg_offset << 4)); in ks_dw_pcie_msi_set_irq()133 ks_pcie->va_app_base + MSI0_IRQ_ENABLE_CLR + (reg_offset << 4)); in ks_dw_pcie_msi_clear_irq()224 writel(0x1, ks_pcie->va_app_base + IRQ_ENABLE_SET + (i << 4)); in ks_dw_pcie_enable_legacy_irqs()233 pending = readl(ks_pcie->va_app_base + IRQ_STATUS + (offset << 4)); in ks_dw_pcie_handle_legacy_irq()243 writel(offset, ks_pcie->va_app_base + IRQ_EOI); in ks_dw_pcie_handle_legacy_irq()324 ks_dw_pcie_set_dbi_mode(ks_pcie->va_app_base); in ks_dw_pcie_setup_rc_app_regs()327 ks_dw_pcie_clear_dbi_mode(ks_pcie->va_app_base); in ks_dw_pcie_setup_rc_app_regs()[all …]
34 void __iomem *va_app_base; member
45 void __iomem *va_app_base; member92 struct pcie_app_reg __iomem *app_reg = config->va_app_base; in spear_dbi_read_reg()114 struct pcie_app_reg __iomem *app_reg = config->va_app_base; in spear_dbi_write_reg()233 struct pcie_app_reg __iomem *app_reg = to_target(item)->va_app_base; in pcie_gadget_link_show()244 struct pcie_app_reg __iomem *app_reg = to_target(item)->va_app_base; in pcie_gadget_link_store()297 struct pcie_app_reg __iomem *app_reg = to_target(item)->va_app_base; in pcie_gadget_no_of_msi_show()336 struct pcie_app_reg __iomem *app_reg = to_target(item)->va_app_base; in pcie_gadget_inta_store()358 struct pcie_app_reg __iomem *app_reg = config->va_app_base; in pcie_gadget_send_msi_store()487 struct pcie_app_reg __iomem *app_reg = to_target(item)->va_app_base; in pcie_gadget_bar0_address_show()498 struct pcie_app_reg __iomem *app_reg = config->va_app_base; in pcie_gadget_bar0_address_store()[all …]