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94 struct pcie_trio_ports_property pcie_ports[TILEGX_NUM_TRIO]; variable197 ret = gxio_trio_get_port_property(context, &pcie_ports[trio_index]); in tile_pcie_open()220 if (!pcie_ports[trio_index].ports[mac].allow_rc && in tile_pcie_open()221 !pcie_ports[trio_index].ports[mac].allow_ep) in tile_pcie_open()242 pcie_ports[trio_index].ports[mac].allow_ep = 1; in tile_pcie_open()467 if (pcie_ports[i].is_gx72 && in tile_pci_init()468 pcie_ports[i].ports[j].allow_rc) { in tile_pci_init()469 if (!pcie_ports[i].ports[j].allow_ep || in tile_pci_init()472 } else if (pcie_ports[i].ports[j].allow_rc && in tile_pci_init()753 if (pcie_ports[trio_index].ports[mac].removable) { in pcibios_init()
2894 pcie_ports= [PCIE] PCIe ports handling: