Searched refs:ICCR (Results 1 - 11 of 11) sorted by relevance

/linux-4.4.14/arch/m68k/ifpsp060/src/
H A Ditest.S33 set ICCR, -132
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6346 mov.w ICCR(%a6),%d0
H A Dftest.S36 set ICCR, -346
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795 mov.w &0x0000,ICCR(%a6)
837 mov.w &0x0000,ICCR(%a6)
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940 mov.w &0x0000,ICCR(%a6)
992 mov.w &0x0000,ICCR(%a6)
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1093 mov.w &0x0000,ICCR(%a6)
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1195 mov.w &0x0000,ICCR(%a6)
1247 mov.w &0x0000,ICCR(%a6)
1288 mov.w &0x0000,ICCR(%a6)
1330 mov.w &0x0000,ICCR(%a6)
1378 mov.w ICCR(%a6),%d0
/linux-4.4.14/drivers/irqchip/
H A Dirq-sa11x0.c27 #define ICCR 0x0C /* IC Control Reg. */ macro
98 st->iccr = readl_relaxed(iobase + ICCR); sa1100irq_suspend()
113 writel_relaxed(st->iccr, iobase + ICCR); sa1100irq_resume()
167 writel_relaxed(1, iobase + ICCR); sa11x0_init_irq_nodt()
/linux-4.4.14/drivers/i2c/busses/
H A Di2c-sh_mobile.c44 /* ICCR: 0x94 0x90 */
51 /* ICCR: 0x94 0x90 */
58 /* ICCR: 0x94 0x90 */
72 /* ICCR: 0x94 0x81 | 0xc0 */
79 /* ICCR: 0x94 0x81 | 0xc0 */
86 /* ICCR: 0x94 0x81 | 0xc0 */
163 #define ICCR 0x04 macro
309 iic_set_clr(pd, ICCR, ICCR_ICE, 0); activate_ch()
326 iic_set_clr(pd, ICCR, 0, ICCR_ICE); deactivate_ch()
345 iic_wr(pd, ICCR, ICCR_ICE | ICCR_TRS | ICCR_BBSY); i2c_op()
358 iic_wr(pd, ICCR, pd->send_stop ? ICCR_ICE | ICCR_TRS i2c_op()
362 iic_wr(pd, ICCR, ICCR_ICE | ICCR_SCP); i2c_op()
370 iic_wr(pd, ICCR, ICCR_ICE | ICCR_RACK); i2c_op()
376 iic_wr(pd, ICCR, ICCR_ICE | ICCR_RACK); i2c_op()
656 iic_set_clr(pd, ICCR, 0, ICCR_ICE); start_ch()
659 iic_set_clr(pd, ICCR, ICCR_ICE, 0); start_ch()
796 iic_set_clr(pd, ICCR, ICCR_ICE, 0); sh_mobile_i2c_r8a7740_workaround()
797 iic_rd(pd, ICCR); /* dummy read */ sh_mobile_i2c_r8a7740_workaround()
804 iic_wr(pd, ICCR, ICCR_SCP); sh_mobile_i2c_r8a7740_workaround()
809 iic_wr(pd, ICCR, ICCR_TRS); sh_mobile_i2c_r8a7740_workaround()
811 iic_wr(pd, ICCR, 0); sh_mobile_i2c_r8a7740_workaround()
813 iic_wr(pd, ICCR, ICCR_TRS); sh_mobile_i2c_r8a7740_workaround()
/linux-4.4.14/arch/arm/mach-pxa/
H A Dirq.c36 #define ICCR (0x014) macro
166 __raw_writel(1, irq_base(0) + ICCR); pxa_init_irq_common()
218 __raw_writel(1, pxa_irq_base + ICCR); pxa_irq_resume()
/linux-4.4.14/arch/arm/mach-sa1100/
H A Dpm.c92 ICCR = 1; sa11x0_pm_enter()
/linux-4.4.14/arch/sparc/include/asm/
H A Dross.h57 /* The ICCR instruction cache register on the HyperSparc.
/linux-4.4.14/drivers/crypto/
H A Dtalitos.h234 #define TALITOS_CCCR_LO_IWSE 0x80 /* chan. ICCR writeback enab. */
H A Dtalitos.c162 /* and ICCR writeback, if available */ reset_channel()
/linux-4.4.14/arch/arm/mach-sa1100/include/mach/
H A DSA-1100.h1196 * ICCR Interrupt Controller (IC) Control Register
1198 * [The ICCR register is only implemented in versions 2.0
1212 #define ICCR __REG(0x9005000C) /* IC Control Reg. */ macro
/linux-4.4.14/arch/powerpc/include/asm/
H A Dreg_booke.h594 /* Bit definitions for ICCR. */

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