Lines Matching defs:spu_priv1
488 struct spu_priv1 { struct
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510 u8 pad_0x28_0x100[0x100 - 0x28]; /* 0x28 */
513 u64 int_mask_RW[3]; /* 0x100 */
527 u8 pad_0x118_0x140[0x28]; /* 0x118 */
528 u64 int_stat_RW[3]; /* 0x140 */
544 u8 pad_0x158_0x180[0x28]; /* 0x158 */
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548 u8 pad_0x188_0x200[0x200 - 0x188]; /* 0x188 */
551 u64 mfc_atomic_flush_RW; /* 0x200 */
553 u8 pad_0x208_0x280[0x78]; /* 0x208 */
554 u64 resource_allocation_groupID_RW; /* 0x280 */
555 u64 resource_allocation_enable_RW; /* 0x288 */
556 u8 pad_0x290_0x3c8[0x3c8 - 0x290]; /* 0x290 */
560 u64 smf_sbi_signal_sel; /* 0x3c8 */
568 u64 smf_ato_signal_sel; /* 0x3d0 */
574 u8 pad_0x3d8_0x400[0x400 - 0x3d8]; /* 0x3d8 */
577 u64 mfc_sdr_RW; /* 0x400 */
578 u8 pad_0x408_0x500[0xf8]; /* 0x408 */
579 u64 tlb_index_hint_RO; /* 0x500 */
580 u64 tlb_index_W; /* 0x508 */
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585 u64 tlb_invalidate_all_W; /* 0x548 */
586 u8 pad_0x550_0x580[0x580 - 0x550]; /* 0x550 */
589 u64 smm_hid; /* 0x580 */
592 u8 pad_0x588_0x600[0x600 - 0x588]; /* 0x588 */
595 u64 mfc_accr_RW; /* 0x600 */
600 u8 pad_0x608_0x610[0x8]; /* 0x608 */
601 u64 mfc_dsisr_RW; /* 0x610 */
610 u8 pad_0x618_0x620[0x8]; /* 0x618 */
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612 u8 pad_0x628_0x700[0x700 - 0x628]; /* 0x628 */
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616 u8 pad_0x708_0x710[0x8]; /* 0x708 */
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618 u8 pad_0x718_0x800[0x800 - 0x718]; /* 0x718 */
621 u64 mfc_dsir_R; /* 0x800 */
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647 u64 mfc_rm_boundary; /* 0x900 */
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